无懈可击之高手如林演员表cpu与外部设备、存储器的连接和数据交换都需要通过接口设备来实现前者被称为I/O接口而后者则被称为存储器接口。存储器通常在cpu的同步控制下工作接口电路比较简单I/O接口的功能是负责实现cpu通过系统总线把I/O电路和外围设备联系在一起。比如SATA它是Serial ATA的缩写即串行ATA。这是一种完全不同于并行ATA的新型硬盘接口类型由于采用串行方式传输数据而得名。SATA总线使用嵌入式时钟信号具备了更强的纠错能力与以往相比其最大的区别在于能对传输指令不仅仅是数据进行检查如果发现错误会自动矫正这在很大程度上提高了数据传输的可靠性。串行接口还具有结构简单、支持热插拔的优点。

　　这组地址信号定义了cpu的最大内存寻址空间为4GB。在地址周期的第一个子周期中这些Pin传输的是交易的地址在地址周期的第二个子周期中这些Pin传输的是这个交易的信息类型。

　　当这个信号被宣称时说明在地址信号上的数据是有效的。在一个新的交易中所有Bus上的信号都在监控ADS#是否有效一但ADS#有效它们将会作一些相应的动作如奇偶检查、协义检查、地址译码等操作。

　　这两个Clock主要用于供应在Host Bus上进行交易所需的Clock。

　　这个信号主要用于宣称一个总线的延迟通过任一个总线c;在这个期间当前总线的拥有者不能做任何一个新的交易。

　　这个信号主要用于对系统总线使用权的仲裁它必须被连接到系统总线的适当Pin 。当BPRI#有效时所有其它的设备都要停止发出新的请求除非这个请求正在被锁定。总线所有者要始终保持BPRI#为有效直到所有的请求都完成才释放总线; Bus Select总线;

　　这两组信号主要用于选择cpu所需的频率下表定义了所选的频率

　　这些信号线是数据总线主要负责传输数据。它们提供了cpu与NB北桥之间64 Bit的通道。只有当DRDY#为Low时总在线的数据才为有效否则视为无效数据。

　　这个信号用于设定GTLn Bus的参考电压这个信号一般被设为Vcc电压的三分之二。

　　这个信号为一ICH输出至cpu的信号。当cpu出现浮点运算错误时需要此信号响应cpu。IGNNE#为Low时cpu会忽略任何已发生但尚未处理的不可遮蔽的浮点运算错误。但若IGNNE#为High时又有错误存在时若下一个浮点指令是FINIT、FCLEX、FSAVE等浮点指令中之一时cpu会继续执行这个浮点指令但若指令不是上述指令时cpu会停止执行而等待外部中断来处理这个错误。

　　这个信号为一由ICH输出对cpu提出中断要求的信号外围设备需要处理数据时对中断控制器提出中断要求当cpu侦测到INTR为High时cpu先完成正在执行的总线c;然后才开始处理INTR中断要求。

　　当cpu的温度传感器侦测到cpu的温度超过它设定的最高度温度时这个信号将会变Low相应的cpu的温度控制电路就会动作。

　　当Reset为High时cpu内部被重置到一个已知的状态并且开始从地址0FFFFFFF0H读取重置后的第一个指令。cpu内部的TLB地址转换参考缓存器、BTB分歧地址缓存器以及SDC区段地址转换高速缓存当重置发生时内部数据全部都变成无效。

　　这个信号一般由cpu拉到地在主机板上的作用主要是来告诉主机板cpu是不是第一次插入。若是第一次插入它会让你进CMOS对cpu进行重新设定。

　　这些讯号主要用于设定cpu的工作电压在主机板中这些信号必须被提升到最高3V。

　　这个信号将会连接一颗电阻到地主要用于内部颜色调色板DAC。这颗电阻的阻值一般为169奥姆精度为1。

　　这个信号说明Master是否可以接受先前以低优先权请求的要读取的数据。当RBF#为Low时中裁器将停止以低优先权去读取数据到Master。

　　这个信号说明Master是否可以准备接受从核心控制器的快写数据。当WBF#为Low时中裁器将停止这个快写数据的交易。

　　这个信号在AGPn 协议中不使用但是它用在PCI协议中由操作系统来管理。关于PME#的详细定义请参加PCI协议规范。

　　从AGP发展来看有1X、2X、4X和8X四种模式每种模式所使用的电压也不尽相同那AGP控制器怎么知到你插的是什么样的显卡呢就是通过这个信号来告诉AGP Control的。用这个信号来设定当前显卡所需的电压。

　　在AGP管道传输时这个信号不使用这个信号只用在AGP的快写方式。

　　这个信号说明AGPn Target已经准备好整个交易所需要读的数据这个Target可以插入等待状态。

　　这个信号在AGP交易时不使用。对于快写方式当STOP#为Low时停止当前交易。

　　在AGP交易时不使用。在快写方式当在一个交易不能完成时它就会被使用。

　　这个信号用于向中裁器请求当前总线使用权为开始一个PCI orn AGP交易。

　　当一个交易开始时提供命令信息。在AGPn Master做写交易时提供有效的位信息。

　　SCMDCLK与SCMDCLK#是差分时钟输出对地址和控制信号都在这个两个Clock正负边沿的交叉点采样。每个DIMM共有三对。

　　当这些信号有效时表示一个Chip已被选择了每个信号对应于SDRAM的一行。

　　这个些信号定义了在每个内存行中哪个Bank被选择。Bank选择信号和内存地址信号联合使用可寻址到内存的任何单元。

　　当在写周期有效时在内存中传输的数据被屏蔽。在这八个信号中每个信号负责八根数据线; Data Strobe数据选通

　　这个信号在上电时对内存进行初始化它们也可以用于关闭不使用的内存数据行。

　　在地址阶段完成后一个频率或是所有写入交易的数据阶段期间在IDRY#被驱动到僭态后一个频率由Initiator驱动。所有读取交易的数据阶段期间在TRDY#被驱动到僭态后一个频率它也

　　由Initiator驱动在AD Bus上传输地址时用来表示当前要动作的指令。在ADn Bus上传输数据时用来表示在目前被寻址之Dword 内将要被传输的字节以及用来传输数据的数据路径。

　　当重置信号被驱动成低态时它会强迫所有PCI组态缓存器Master及Target状态机器与输出驱动器回到初始化状态。RST#可在不同步于PCI CLK边缘的状况下被驱动或反驱动。RST#的设定也将其它的装置特定功能初始化但是这主题超出PCI规格的笵围。所有PCI输出信号必须被驱动成最初的状态。通常这表示它们必须是三态的。

　　是由目前的Initiator驱动它表示交易的开始当它开始被驱动到低态时与期间在它被驱动支低态期间。为了碓定是否已经取得总线c;Master必须在同一个PCI CLK信号的上边缘取样到FRAME#与IRDY#都被反驱动到高态且GNT#被驱动到低态。交易可以是由在目前的Initiator与目前所寻址的Target间一到多次数据传输组成。当Initiator准备完成最后一次数据阶段时FRAME#就会被反驱动到高态。

　　Target备妥被目前所寻址的Target驱动。当Target准备完成目前的数据阶段数据传输时它就会被驱动到低态。如果在同一个PCI CLK信号的上升边缘Target 驱动TRDY#到低态且Initiator驱动IDRY#到低态的线c;则此数据阶段便告完成。在读取期间TRDY#被驱动表示Target正在驱动有效的数据到数据总线上。在写入期间TRDY#被驱动表示Target准备接收来自Master的资料。等待状态会被插入到目前的资料阶段里直到取样到TRDY#与IRDY#都被驱动到低态为止。

　　该信号有效时表示驱动它的设备已成为当前防问的目标设备。换言之该信号的有效说明总在线某处的某一设备已被选中。如果一个主设备启动一个交易并且在6个CLK周期内设有检测到DEVSEL#有效它必须假定目标设备没能反应或者地址不存在从而实施主设备缺省。

　　IDSEL是PCI装置的一个输入端并且在存取某个装置的组态缓存器期间它用来选择芯片。

　　表示管理者要求使用总线c;此为一对一之信号每一管理者都有与其相对应之REQ#信号。

　　表示管理者对总线使用之要求已被同意此为一对一之信号每一管理者都有与其相对应之GNT#信号。

　　这个信号与SATARBIAS一样外接一颗与GND相接的电阻为SATA提供一个电压偏置。

　　当这个信号为Low时表示当前的SATA硬盘正在读写数据。

　　这个信号由南桥来驱动当它有效时表示要对磁盘进行一个读操作。

　　这个信号由南桥来驱动当它有效时表示要对磁盘进行一个写操作。

　　上面两个信号线为系统管理总线c;以南桥为控制中心对主机板的一些Device进行读写操作如倍频IC、SPD等等。这两个信号在外部必须通过电阻进行Pull High。

　　步进输出脉冲当此信号为Low时将产生一个脉冲移动磁头到另一个磁道。

　　盘片更换当此信号为Low时在上电状态可随时取出盘片。

　　这个Pin主要用于选择打印机模式为High时表示打印机被选择。打印有两种模式可以被设定ECP和EEP。

　　当这个信号为High时表示打印机很忙没有准备去接收数据。

　　当这个信号为Low时表示打印机已接收数据并准备接受更多的数据。

　　当打印机打印针出问题时这个信号会被拉Low打印机会自动再打一遍。

　　这个信号用于Modem控制输入这个功能可以通过读握手状态寄存器Bit 4来测试。

　　这个信号为Low时表示Modem或数据放置已准备可以传输数据。

　　这个信号为Low时表示Modem或调制解调器可准备去发送数据。

　　[导读] cpu与外部设备、存储器的连接和数据交换都需要通过接口设备来实现，前者被称为I/O接口，而后者则被称为存储器接口,cpu接口信号各自代表不同的意思，比如BPRI# （I） Bus Priority Request（总线优先权请求）这个信号主要用于对系统总线使用权的仲裁，它必须被连接到系统总线的适当Pin 。关键词：接口信号CPUcpu与外部设备、存储器的连接和数据

　　，同时保持完全的软件兼容性。LPC 规范具有优于 ISA/X 总线的几个关键优势，例如减少了引脚数，从而使设计更容易，更具成本效益。在软件应用方面，LPC

　　规范对于 I/O 功能是透明的，并且与现有的外围设备和应用程序兼容。 LPC

　　LPC总线的介绍资料，中文介绍，例如IO读写、内存读写、DMA读写、Firmware memory读写等。对于初涉及的软硬件学习 是良好的资料笔记。

　　名词解释之SLP_S3# SLP_S5#及SUSB# SUSC# 3 电脑

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