陈美心makiyo架构通过支持协处理器来扩展处理器的功能。ARM架构的处理器支持最多16个协处理器，通常称为CP0~CP15。下述的协处理器被ARM用于特殊用途：

　　CP15：提供系统控制功能，主要用于配置MMU、TLB和Cache等功能。

　　CP10、CP11：两个协处理器一起提供了对浮点运算和向量操作的支持，这两个协处理器主要用于控制和配置浮点功能和高级SIMD指令扩展。

　　CP15是系统控制协处理器，主要用于对ARM处理器核心支持的许多特性功能进行配置。CP15协处理器支持16个32位主寄存器（primary register），命名为c0~c15。c0~c15主寄存器各自又有多个32位的物理寄存器（physical register）。CP15协处理器的大多数寄存器不能在USR模式下访问，只能在除USR模式外的其他模式下访问。下面列出c0~c15中比较常用的寄存器：

　　在CP15协处理器中，c0~c15每个主处理器下面有多个物理寄存器，上述表格只列出了部分常用的物理寄存器。

　　ARMv7-A体系结构的处理器提供了MRC和MCR指令用于对协处理器进行读写操作。MRC指令用于将CP15协处理器中的寄存器数据读取到ARM通用寄存器中。MCR指令用于将ARM通用寄存器中的数据写入到CP15协处理器的寄存器中。

　　CRn为协处理器寄存器，对于CP15协处理器来说，CRn取值范围为c0~c15。

　　CRm为协处理器寄存器，对于CP15协处理器来说，通过CRm和opc2一起来确定CRn对应的具体寄存器。

　　opc2为可选的协处理器执行操作码，取指范围为0~7，当不需要的时候要设置为0。

　　CRn为协处理器寄存器，对于CP15协处理器来说，CRn取值范围为c0~c15。

　　CRm为协处理器寄存器，对于CP15协处理器来说，通过CRm和opc2一起来确定CRn对应的具体寄存器。

　　opc2为可选的协处理器执行操作码，取指范围为0~7，当不需要的时候要设置为0。

　　CP15协处理器有c0~c15总共16个主寄存器，在每个主寄存器下面，又有多个物理寄存器。下图总结了CP15协处理器的寄存器组织形式：

　　上图对于MRC和MCR指令所要使用到的一些参数都标明了，对于想要访问CP15协处理器相关寄存器，只需要看图填写好参数就行了。下面具体列一下c0~c15各个主寄存器的组成。

　　在CP15协处理器的寄存器中，系统控制寄存器SCTLR是被访问的比较多的寄存器。对SCTLR寄存器的访问需要在PL1或者更高的特权等级。SCTLR寄存器的位关系如下图所示：

　　主寄存器c2和c3主要提供内存保护和内存控制相关的功能，c2和c3寄存器的组成如下图所示：

　　在任何基于ARMv7实现的处理器中，协处理器CP15的c4寄存器没有被使用。

　　主寄存器c5和c6主要提供内存系统错误上报功能，c5和c6寄存器的组成如下图所示：

　　主寄存器c7主要提供cache维护，地址转换和内存屏障操作相关的功能，c7寄存器的组成如下图所示：

　　主寄存器c9保留用于分支预测，cache和TCM操作，c9寄存器的组成如下图所示：

　　主寄存器c10主要提供内存重映射和TLB控制相关的功能，c10寄存器的组成如下图所示：

　　这里只是简单的将CP15各个主寄存器的组成列出来了，方便在使用MRC和MCR指令配置CP15主寄存器时，查看指令各个参数的设置，以及对照配置的具体寄存器，至于寄存器的具体内容由于篇幅原因就不列出来了，CP15寄存器的细节可以参考ARMv7AR手册的B3.17章节内容。

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