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　　前景如斯夸姣既然CXL的，L的产物还比力少但目前能支撑CX，L 3.0规范才刚发布终究具有适用价值的CX，上还需要必然的时间使用在具体的产物。经有一些产物但市场上已，处置器巨头也已起头支撑CXL而且Intel和AMD这两大。

　　CXL.io：基于PCIe规范CXL尺度次要由三大和谈形成：，了加强但进行，、设备发觉和列举、中缀、DMA等次要供给设置装备摆设、链接初始化和办理。用易失性（如RAM）或非易失性存储（如闪存）的load/store号令去拜候其他设备的内存CXL.cache：答应其他设备以极低延迟去拜候主机DRAM内存：答应主机（CPU）通过使。

　　于CPU的DIMM插槽是无限的扩展主机DRAM内存容量：由，做法是添加办事器内部的CPU数量提拔办事器DRAM内存容量的保守，路及以上办事器好比四路、八，复杂手艺，本高成，务器的机能并不是两台四路办事器之和）并且机能并不克不及线性（典型如一台八路服。量的环境下显著提拔DRAM内存容量所以操纵CXL能在不添加CPU数。

　　范能够实现内存池CXL 2.0规，机零丁分派既能够给主，共享利用也能够，0 Switch也能实即便没有CXL 2.现

　　时同，（Memory Pooling）”的使用在CXL 2.0规范中还实现了“内存池，用需求的分歧按照现实应，面三种设置装备摆设能够实现下：

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　　机能金字塔”Intel“，DRAM内存的弥补傲腾持久内存则作为，容量优供给大势

　　前目，曾经在本年8月发布CXL 3.0规范，e 6.0基于PCI，的版本则基于PCIe 5.0而之前的CXL 2.0及更早。6.0尺度来看连系PCIe ，Ie通道下16条PC，21GB/s带宽高达1；则高达242GB/s而PCIe 7.0，存带宽八两半斤那根基上能与内，是说也就，上是可行的CXL理论。

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　　物理电气层、链路层和传输层）基于PCIe规范条理化设想（，议层添加响应和谈CXL在响应协，新传输能以实现力

　　.0、容量可达3.2TB的P5800X最新一代的傲腾SSD采用PCIe 4，M.2两种形态只要U.2和；久内存傲腾持，PM100系列黑色为第一代，PM200系列蓝色为第二代，量并无变化两代产物容，代机能有提拔但据称第二。

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　　XL 3.0则进一步加强了CXL的现实利用而在本年8月FMS 2022大会上发布的C，以构成一个矩阵操纵CXL可，一的“内存资本池”在更大标准构成统，需分派并按，图所示如下：

　　会成员以外除了董事，联想与凡甲科技等是贡献者会员包罗腾讯、无锡众星微、海潮、，国公司就更多了而采用者中的中，逐个列举了在此就不。来说总的，（IBM）以及CCIX (Xilinx )等开放尺度之后CXL在归并了包罗Gen-Z（HPE）、OpenCAPI，界的顶级尺度组织之一仿佛已成为IT互联网。

　　21（超算21）上展现了Demo现实使用方面：Intel在SC， 2022上而在FMS，ud）传播鼓吹曾经用于其云数据核心内弹性云（Elastics.clo。

　　NIC等无缓存或只要少量缓存的环境下将主机DRAM内存分享给加快器：诸如，大缓存但愿增，ache）就能够操纵CPU的DRAM内存操纵CXL（即CXL.io和CXL.c，用的内存容量显著提高可使，繁琐的流程且无需颠末。tel的集成显卡这一点有点像In。

　　同效率：诸如AI之类的使用提拔CPU与加快器之间的协，发机能来提高响应速度需要GPU等设备的并，的缓存无限可是GPU，PU需要数据搬运且计较成果奉告C，与GPU之间的内存互访而操纵CXL实现CPU，延迟降低。

　　腾SSD抛开傲，持久内存只谈傲腾，存利用（机能不如DRAM）傲腾持久内存能够当大容量内，内存来作为傲腾的缓存系统内仍需要DRAM；存放使用数据）利用也能够当持久存储（，的读写机能供给最快。务器内无限的DIMM插槽这两种利用模式都要占领服，的好坏势而利用，见仁见智只能说，场上大规模利用归正没能在市。

　　决于现实目标和设备CXL怎样用要取。）和自带内存/缓存的加快器（最典型的就是GPU）好比设备分为不带内存/缓存的设备（如NIC网卡，文所说的同时如前，大内存容量和机能互联网巨头但愿增，存扩展目标也就是内。

　　范畴最顶级的尺度制定组织之一CXL能够说是目前数据核心，数量就能够看出从董事会成员，持CXL的产物或接近方案所以其他成员还有良多支，一列举了就不再一。

　　）数据核心规模越来越大企业（特别是互联网公司，巨头的办事器数量大多以百万计办事器数量越来越多（互联网，gle、微软与阿里）好比AWS、Goo，存的采购量越来越大必然对DRAM内，模效应因为规，本有着极高的要求必然对可控的成。M内存手艺缘由可是由于DRA，GB成本）只能降到必然程度DRAM内存的单元成本（每。

　　e Express LinkCXL的全称是Comput，思义顾名，DRAM内存的高速毗连尺度是CPU到设备、CPU到。SmartNIC（智能网卡）、GPU等这些设备包罗诸如ASIC、FPGA、，AM内存扩展以及实现DR。定CXL规范的组织CXL联盟就是制，IT互联网业界的顶流内部几乎包含了整个，事会成员公司下图是其董：

　　是进行了一个很斗胆的设想而Marvell公司更，-of组合起来利用将CXL与NVMe，心的新架构构成数据中，下图如：

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　　之就是简而言，PU）都是各自利用各自的内存以前CPU与其他设备（好比G，者的内存整合到一路此刻CXL答应将两，e的CXL能够互相拜候让两者通过基于PCI，商赚差价”没有“两头，机能低延迟所以能高。

　　环节的问题——算力同时还有另一个很是。数量越来越多处置器的焦点，”手艺让焦点数量敏捷翻倍特别是“Chiplet，YC处置器为例以AMD EP，的32焦点从最起头，64焦点成长到，”可达96焦点最新的“热那亚，架构的“贝加莫”将达到128焦点即将到来的采用“Zen 4c”微。存手艺的停滞而DRAM内，内存带宽是下降的意味着每焦点获得。

　　处置器（也就是“热那亚（Genoa）”的下一代）支撑CXLCPU方面：AMD颁布发表在代号“贝加莫（Bergamo）”的，er Lake上支撑Intel则在Ald。

　　处理方案：利用CXL对DRAM进行扩展CXL联盟（Meta与Google）的，和容量的增实现机能长

　　宽不增加也就算了每焦点可用内存带，下降了竟然还！网公司）对算力的追求长短常极致的是可忍孰不成忍？企业（特别是互联，严峻障碍了算力增加那么此刻DRAM，与可控成本的需求呢？这就是CXL降生的缘由该若何处理内存的可扩展性（大容量和带宽），ogle和Meta展现的处理方案下图是CXL联盟董事会成员Go：

　　议所能供给的带宽各代PCIe协，0的x16条通道带宽仍是很有引诱力PCIe 6.0和PCIe 7.的

　　说法就是换一种，度上设想办事器能够在更大尺，柜为一台办事器好比以整个机，同的资本池别离构成不，存资本池以及加快器资本池等等好比CPU资本池、DRAM内。

　　的单元成本像红线那样持续走低互联网巨头们但愿DRAM内存，前后就根基连结稳但现实倒是蓝线年定

　　腾傲，都晓得大师，前后推出的一种新型存储介质是Intel在2017年，机能）、低延迟与高寿命等特点具有高机能（划一程度的读写。持久内存两种产物形态并有傲腾SSD和傲腾。

　　CXL规范比拟与上几个版本的，升级并新增了良多功能CXL 3.0规范，CXL的适用极大地加强了性

　　构思：操纵CXL整合计较资本Marvell公司提出的新，of整合存储资用NVMe-源